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引言
本文讨论如何理解for循环在逻辑电路中的实现。通过各种写法的rtl电路对比，来探讨for循环的等价电路，或者for电路的等价展开电路。
for循环示例
如下给出一个for循环使用的例子，我们来...
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2022-05-02 01:01:50
你接手一个项目，如果不是新建，总有想要查看器件类型、软件版本的需求，如何快速获取这些信息呢？
log文件是个好东西，无论是综合目录下的runme.log
还是实现目录下的runme.log都可以查看...
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2022-04-17 01:00:19
GT的电源控制
GTX/GTH收发器支持一系列的断电模式。这些模式既支持通用的电源管理功能，也支持PCI Express®和SATA标准中定义的功能。每个方向的每个通道都可以使用TXPD和RXPD分别关...
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2021-11-01 01:01:21
RX初始化与复位
GTX/GTH收发器RX使用一个复位状态机来控制复位过程。由于其复杂性，GTX/GTH收发器RX被划分为比GTX/GTH收发器TX更多的复位区域。如图所示，该分区允许RX的初始化和复位...
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2021-10-30 01:01:03
TX初始化与复位过程
GTX/GTH收发器TX使用一个复位状态机来控制复位过程。GTX/GTH收发器TX被划分为两个复位区域，TX PMA和TX PCS。该分区允许TX初始化和复位只在顺序模式下操作，如...
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2021-10-28 01:02:07
CPLL复位
CPLL必须使用CPLLPD端口断电，直到FPGA结构中检测到参考时钟边沿。在CPLLPD无效后，CPLL必须在使用前进行复位。每个GTX/GTH收发器通道有三个专用端口用于CPLL复位。...
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2021-10-25 01:03:01
常常在外文资料以及手册中看到Fabric？时常感觉翻译起来很尴尬，例如：
那么这个专业单词到底该如何翻译以及如何理解呢？
我们通过资料： http://xilinx.eetop.cn/viewnew...
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2021-10-19 01:00:27
如下为transceiver的TX模块的结构框图：
今天内容不是介绍其内部各个结构的作用，而是介绍这里面存在时钟及其关系。
时钟仍然使我们今天的主题。
首先是框图的最右边FPGA TX Inte...
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2021-10-18 01:02:12
Transceiver内部时钟架构如下：
Transceiver内部时钟来源可以是QPLL也可以是自己的CPLL。
其内部TX 和 RX 时钟分频器可以单独从 QPLL 或 CPLL 中选择时钟，允...
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2021-10-16 01:00:49
前言
对于7系列的FPGA，共有3个系列，每个系列都有各自的高速收发器，称为吉比特收发器，即Gigabit Transceiver，简称为GT。
每个系列的GT叫法略有不同，分别为：
A7 的GTP...
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2021-10-10 01:01:06
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