Verilog 中输入输出信号的类型?

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李锐博恩 发表于 2021/07/15 04:46:53 2021/07/15
【摘要】 虽然只有一句话,但很重要,足以总结标题上的疑问? 输入端口可以由wire/reg驱动,但输入端口只能是wire;输出端口可以使wire/reg类型,输出端口只能驱动wire。        

虽然只有一句话,但很重要,足以总结标题上的疑问?

输入端口可以由wire/reg驱动,但输入端口只能是wire;输出端口可以使wire/reg类型,输出端口只能驱动wire。

 

 

 

 

文章来源: reborn.blog.csdn.net,作者:李锐博恩,版权归原作者所有,如需转载,请联系作者。

原文链接:reborn.blog.csdn.net/article/details/89364904

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